关于虚拟机Vhd文件问题
一共有2个虚拟机, 将vhd差异磁盘拷贝到另一台虚拟机上,并且第二台虚拟机的父盘是
从第一台拷贝过来的,但是vhd文件不能用,不知道为什么,

1个回答

可以先在hyper-v上合并差异磁盘,得到完整的vhd,然后再导入第二台计算机。

Zzp__
Zzp__ 回复caozhy: 如果直接拷贝过去,但是vhd用不了,是什么原因呢,会不会跟父盘的标识号有关,想请教一下是否还有其他原因
3 年多之前 回复
Zzp__
Zzp__ 回复caozhy: 谢谢
3 年多之前 回复
caozhy
贵阳老马马善福专业维修游泳池堵漏防水工程 回复Zzp__: 删除文件、改写文件都可能产生碎片
3 年多之前 回复
Zzp__
Zzp__ 回复caozhy: 请问是在动态增长时产生的碎片,还是删除文件时产生的,对这一块不是很了解,您能细致的讲解一下吗你,谢谢
3 年多之前 回复
caozhy
贵阳老马马善福专业维修游泳池堵漏防水工程 回复Zzp__: 你用的是动态增长么?那样会产生碎片,hv提供了压缩磁盘的工具,但是不太好用。还不如创建一个新的磁盘,用ghost导一次。
3 年多之前 回复
Zzp__
Zzp__ 回复Zzp__: 使用量没有减少,抱歉,刚才打错了。
3 年多之前 回复
Zzp__
Zzp__ 还有一个问题想请教,差异磁盘会越来越大。删除没用的文件后,他的使用量也减少,不知道被占用的空间,是以哪种形式存在的。是像碎片一样吗?
3 年多之前 回复
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Please refer to the applicable -- agreement for further details. -- *************************************************************************** -- This file contains a Vhdl test bench template that is freely editable to -- suit user's needs .Comments are provided in each section to help the user -- fill out necessary details. -- *************************************************************************** -- Generated on "04/14/2017 19:32:52" -- Vhdl Test Bench template for design : fft -- -- Simulation tool : ModelSim (VHDL) -- LIBRARY ieee; USE ieee.std_logic_1164.all; ENTITY fft_vhd_tst IS END fft_vhd_tst; ARCHITECTURE fft_arch OF fft_vhd_tst IS -- constants -- signals SIGNAL clk : STD_LOGIC; SIGNAL fftpts_in : STD_LOGIC_VECTOR(3 DOWNTO 0); SIGNAL fftpts_out : STD_LOGIC_VECTOR(3 DOWNTO 0); SIGNAL reset_n : STD_LOGIC; SIGNAL sink_eop : STD_LOGIC; SIGNAL sink_error : STD_LOGIC_VECTOR(1 DOWNTO 0); SIGNAL sink_imag : STD_LOGIC_VECTOR(31 DOWNTO 0); SIGNAL sink_ready : STD_LOGIC; SIGNAL sink_real : STD_LOGIC_VECTOR(31 DOWNTO 0); SIGNAL sink_sop : STD_LOGIC; SIGNAL sink_valid : STD_LOGIC; SIGNAL source_eop : STD_LOGIC; SIGNAL source_error : STD_LOGIC_VECTOR(1 DOWNTO 0); SIGNAL source_imag : STD_LOGIC_VECTOR(31 DOWNTO 0); SIGNAL source_ready : STD_LOGIC; SIGNAL source_real : STD_LOGIC_VECTOR(31 DOWNTO 0); SIGNAL source_sop : STD_LOGIC; SIGNAL source_valid : STD_LOGIC; CONSTANT clk_period : TIME := 20 ns; COMPONENT fft PORT ( clk : IN STD_LOGIC; fftpts_in : IN STD_LOGIC_VECTOR(3 DOWNTO 0); fftpts_out : OUT STD_LOGIC_VECTOR(3 DOWNTO 0); reset_n : IN STD_LOGIC; sink_eop : IN STD_LOGIC; sink_error : IN STD_LOGIC_VECTOR(1 DOWNTO 0); sink_imag : IN STD_LOGIC_VECTOR(31 DOWNTO 0); sink_ready : OUT STD_LOGIC; sink_real : IN STD_LOGIC_VECTOR(31 DOWNTO 0); sink_sop : IN STD_LOGIC; sink_valid : IN STD_LOGIC; source_eop : OUT STD_LOGIC; source_error : OUT STD_LOGIC_VECTOR(1 DOWNTO 0); source_imag : OUT STD_LOGIC_VECTOR(31 DOWNTO 0); source_ready : IN STD_LOGIC; source_real : OUT STD_LOGIC_VECTOR(31 DOWNTO 0); source_sop : OUT STD_LOGIC; source_valid : OUT STD_LOGIC ); END COMPONENT; BEGIN i1 : fft PORT MAP ( -- list connections between master ports and signals clk => clk, fftpts_in => fftpts_in, fftpts_out => fftpts_out, reset_n => reset_n, sink_eop => sink_eop, sink_error => sink_error, sink_imag => sink_imag, sink_ready => sink_ready, sink_real => sink_real, sink_sop => sink_sop, sink_valid => sink_valid, source_eop => source_eop, source_error => source_error, source_imag => source_imag, source_ready => source_ready, source_real => source_real, source_sop => source_sop, source_valid => source_valid ); init : PROCESS -- variable declarations BEGIN sink_error<="00"; source_ready<='1'; fftpts_in<="1000"; reset_n<='1' ; sink_valid<='1'; -- code that executes only once WAIT; END PROCESS init; clk_generation:process begin clk<='1' ; wait for clk_period/2; clk<='0' ; wait for clk_period/2; end process; always : PROCESS -- optional sensitivity list -- ( ) -- variable declarations BEGIN sink_imag<=(others=>'0'); sink_real<=(others=>'0'); -- code that executes only once sink_eop<='0'; sink_sop<='0'; wait until rising_edge(clk); wait until rising_edge(clk); sink_sop<='1'; sink_real<="00000000010000000000000000000000"; sink_imag<="00000000010000000000000000000000"; wait until rising_edge(clk); sink_sop<='0'; sink_real<="00000000011000000000000000000000"; sink_imag<="00000000011000000000000000000000"; wait until rising_edge(clk); sink_real<="00000000011100000000000000000000"; sink_imag<="00000000011100000000000000000000"; wait until rising_edge(clk); sink_real<="00000000011110000000000000000000"; sink_imag<="00000000011110000000000000000000"; wait until rising_edge(clk); sink_real<="00000000011111000000000000000000"; sink_imag<="00000000011111000000000000000000"; wait until rising_edge(clk); sink_real<="00000000011111100000000000000000"; sink_imag<="00000000011111100000000000000000"; wait until rising_edge(clk); sink_real<="00000000011111110000000000000000"; sink_imag<="00000000011111110000000000000000"; wait until rising_edge(clk); sink_eop<='1'; sink_real<="00000000011111111000000000000000"; sink_imag<="00000000011111111000000000000000"; wait until rising_edge(clk); sink_eop<='0'; wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk);wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); wait until rising_edge(clk); -- code executes for every event on sensitivity list WAIT; END PROCESS always; END fft_arch; ``` 输出是下面的图: ![modelsim仿真结果](https://img-ask.csdn.net/upload/201704/14/1492181755_473843.png) 从输出的_fftpts_out 来看,ip核是能检测到了输入的。但是8个数据输入后输出并没有反应 ipcore是8数据,单浮点,可变流。
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第一幕:缘起 听说阎王爷要做个生死簿后台管理系统,我们派去了一个程序员…… 996程序员做的梦: 第一场:团队招募 为了应对地府管理危机,阎王打算找“人”开发一套地府后台管理系统,于是就在地府总经办群中发了项目需求。 话说还是中国电信的信号好,地府都是满格,哈哈!!! 经常会有外行朋友问:看某网站做的不错,功能也简单,你帮忙做一下? 而这次,面对这样的需求,这个程序员...
网易云6亿用户音乐推荐算法
网易云音乐是音乐爱好者的集聚地,云音乐推荐系统致力于通过 AI 算法的落地,实现用户千人千面的个性化推荐,为用户带来不一样的听歌体验。 本次分享重点介绍 AI 算法在音乐推荐中的应用实践,以及在算法落地过程中遇到的挑战和解决方案。 将从如下两个部分展开: AI算法在音乐推荐中的应用 音乐场景下的 AI 思考 从 2013 年 4 月正式上线至今,网易云音乐平台持续提供着:乐屏社区、UGC...
8年经验面试官详解 Java 面试秘诀
作者 |胡书敏 责编 | 刘静 出品 | CSDN(ID:CSDNnews) 本人目前在一家知名外企担任架构师,而且最近八年来,在多家外企和互联网公司担任Java技术面试官,前后累计面试了有两三百位候选人。在本文里,就将结合本人的面试经验,针对Java初学者、Java初级开发和Java开发,给出若干准备简历和准备面试的建议。 Java程序员准备和投递简历的实...
面试官如何考察你的思维方式?
1.两种思维方式在求职面试中,经常会考察这种问题:北京有多少量特斯拉汽车?某胡同口的煎饼摊一年能卖出多少个煎饼?深圳有多少个产品经理?一辆公交车里能装下多少个乒乓球?一个正常成年人有多少根头发?这类估算问题,被称为费米问题,是以科学家费米命名的。为什么面试会问这种问题呢?这类问题能把两类人清楚地区分出来。一类是具有文科思维的人,擅长赞叹和模糊想象,它主要依靠的是人的第一反应和直觉,比如小孩...
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