makefile变量展开为空

我在学apue.h的时候写了一个makefile文件,内容是这样的
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然后我发现我自己make的时候,里面我定义的变量展开的都是空值,比如说我
定义了一个INC =-I ../include变量,在gcc $(INC) -c -o connectretry.o connectretry.c那一行就解释成了一块空格 这是怎么回事?

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3个回答

命令输入 MAKE all

感觉执行的不是你写的makefile。你里面写的是用gcc编译,执行输出的语句是用cc.

我觉得这个问题应该不是定义的变量展开的都是空值的问题

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linux,makefile中的依赖关系是Makefile是什么意思

如下列中Makefile是什么意思,求指点。谢谢!!! fsupdate:Makefile @echo "-------- Copying binaries to [ $(TARGET_FS) ] --------" ########################## fsupdate cp $(KERNELDIR)/drivers/video/ti81xx/vpss/vpss.ko $(TARGET_FS_DIR)/kermod/.

Makefile切换目录(windows平台)

在linux下使用Makefile时,可以切换目录,并且执行该目录下的另一个Makefile文件: 例如执行window目录下的另一个Makefile文件: ``` window/window.obj: (cd window; make) ``` 在windows环境下,这个写法不行,具体该怎样写呢? 补充一点:没有使用现成的编译环境,编译器是基于gcc的,具体是在cmd.exe下用make.exe执行Makefile来进行编译的

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