verilog语法问题，截取多位寄存器中连续的某些位赋值

44位的寄存器[43:0]DataBuf;

截取其中八位，比如第4到第11是用DataBuf[11:4]吗？

复制到buf<=DataBuf[11:4];这样对吗？

如果正确为什么我仿真时这一步后buf中毫无变化？

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verilog语法问题，截取多位寄存器中连续的某些位赋值开发语言
2020-12-15 15:37

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Verilog中always语法错误 fpga开发其他开发语言
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verilog 语法问题 fpga开发
2022-10-09 23:56

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FPGA的verilog语言关于小数计算的问题？ fpga开发
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Verilog语言用case语句中不定态x的用法开发语言
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