MS1023串化器输入经过曼彻斯特编码的4路信号,其余6路输入信号置高电平。1023处于随机锁定同步。但是信号到达1224解串器,1224的lockn一直处于高电平,从而导致一直无法解串。请问可能是什么原因?(1023串化信号经光模块传输到1224)怀疑可能是没有同步导致,如何在代码里面配置呢?(verilog语言)或者说如何使1023与1224处于随机锁定同步呢?

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