fight_sward666 2023-10-30 14:18 采纳率: 0%
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数电存储器求解答,23考研真题

求该题的解答的步骤,从第三问开始就看不懂了,谢谢各位哥!该题为电子技术基础考研,不懂第三问以后该如何做!没有思路,求一完整解答

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  • 社区专家-Monster-XH 2023-10-30 14:18
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    基于Monster 组和GPT的调写:

    1. 求比较器位数:8位。

      • 分辨绝对值最小为0.004V,这实际上是给出的量化步长。
      • 2^n * 0.004V = Vref, 这里的Vref是参考电压,通常是模拟输入信号的最大电压。
      • 对于8bit的存储,有2^8 = 256个量化级。因此,0.004V * 256 = 1.024V。这意味着Vref = 1.024V。
      • 从上面的计算可以得知,比较器的位数确实是8。
    2. 逐次比较的周期:8个周期。

      • 对于8bit的转换器,最坏情况下,它需要进行8次比较才能确定一个数字化的值。
      • 一个比较周期由CLK1的一个周期决定。因此,总的逐次比较的周期为8个CLK1周期。
    3. 用采样定理,完整存储1S的信号,至少要多少片4K 8bit的存储:2片4K 8bit储存。

      • 根据奈奎斯特采样定理,采样频率应至少为信号最大频率的两倍。给定信号的最大频率为4KHZ,所以最小采样频率为8KHZ。
      • 在1秒内,至少需要采样8,000次。
      • 每次采样存储为8bit,那么1秒的数据为8,000 * 8bit = 64,000bits = 64Kbits。
      • 每片存储为4K * 8bit = 32Kbits。
      • 因此,你需要2片4K 8bit的存储来完整存储1S的信号。
    4. CLK1为400KHZ时,1S内能采多少个信号:66.7K个信号

      • 由于每15MS存储一次,所以采样频率为1/15MS = 66.67KHZ。
      • 在1秒内,会采集66.67K个信号。
    5. CLK2的频率:66.67KHZ

      • 这里并没有给出CLK2的具体信息,但考虑到它直接驱动存储系统,可以假设它与采样率相关。
      • 如果我们仍然以每15MS存储一次为基准,那么CLK2的频率也应为66.67KHZ。
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