Allegro更新原理图导入网表，Xnet混乱何解？

Question

在更新原理图后导入网表后，Allegro莫名其妙将原本组合好的Xnet的差分自动组合成新的Xnet。这些Xnet是没有模型存在的（去掉过模型导入的），现在就是组合成一个Xnet后差分设置不了。按照在原理图中给器件添加一个值为TURE的No Xnet Connection属性后把这个Xnet打散了可以设置差分，但是不能重新生成模型添加Xnet。请问有什么办法可以解决或者提前规避出现这样的问题吗？（版本17.2）

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1. 关键点分析：
   - 原理图更新后导入网表，Allegro自动将原本组合好的Xnet差分重新组合，导致新的Xnet无模型且差分设置失效。
2. 解决方案：
   - 检查原理图和网表设置：
   • 确保原理图中差分对的定义准确无误。差分对的引脚名称、电气类型等设置要符合规范。例如，差分对的正负极引脚名称通常有特定的命名规则，如P和N等。
   • 在生成网表时，检查网表生成工具的设置，确保差分对信息正确传递到网表中。不同的原理图设计工具生成网表的方式可能不同，需要根据具体工具进行相应设置。
   • 在Allegro中重新整理Xnet：
   • 打开Allegro PCB文件。
   • 使用Allegro的网络编辑功能（如Route -> Edit Nets）。
   • 找到新生成的混乱Xnet，手动将其拆分成原来正确的差分对。例如，如果新的Xnet将多个差分对组合在一起，仔细分辨每个差分对的引脚连接，将它们分别提取出来重新组成正确的差分对。
   • 重新为拆分后的差分对设置差分属性。在网络编辑界面中，选中差分对的网络，右键点击选择Properties，在弹出的属性对话框中设置差分对的相关属性，如差分阻抗等。
   • 检查模型关联：
   • 确认没有模型导入的情况下，手动为每个差分对添加正确的模型。在Allegro中，可以通过Assign Package and Symbol命令，为每个引脚分配正确的封装和模型。对于差分对，确保正负极引脚都关联到正确的差分模型。
   • 检查模型路径是否正确。如果模型文件存储在特定的路径下，确保Allegro能够正确访问该路径。可以在Allegro的设置中检查模型搜索路径，如有必要，更新路径以包含模型文件所在位置。
3. 不同解决方案优缺点：
   - 检查原理图和网表设置：
   • 优点：从源头上解决问题，如果是原理图或网表生成过程中的错误导致Xnet混乱，这种方法可以彻底纠正错误，避免后续在PCB中反复调整。
   • 缺点：需要对原理图设计工具和网表生成过程有深入了解，排查过程可能较为复杂，需要仔细检查各种设置。
   • 在Allegro中重新整理Xnet：
   • 优点：直接针对Allegro中出现的问题进行修复，相对较为直观，能够快速解决当前PCB文件中的Xnet混乱情况。
   • 缺点：没有从根本上解决原理图和网表的问题，如果后续再次更新原理图导入网表，可能还会出现类似问题。
   • 检查模型关联：
   • 优点：确保差分对有正确的模型，对于后续的电气性能分析和仿真等工作非常重要，可以保证设计的完整性。
   • 缺点：主要解决模型相关问题，不能直接解决Xnet自动组合混乱的根本原因，如果Xnet组合问题是由其他因素引起的，单独检查模型关联可能无法完全解决问题。
4. 总结：
   - 首先要仔细检查原理图和网表设置，确保差分对信息准确传递。若问题仍然存在，在Allegro中手动重新整理Xnet并设置差分属性。最后，检查模型关联，确保每个差分对都有正确的模型。通过这些步骤，可以逐步解决Allegro中Xnet混乱以及差分设置失效的问题。

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