在设计小信号放大电路时，常采用单管共射或共源结构，其电压增益受限于晶体管跨导与负载电阻的乘积。而双管放大电路（如共射-共基或共源-共栅级联结构）通过级联方式可显著提升交流输出阻抗和增益带宽积。请问：在相同工艺与偏置条件下，双管级联放大电路相较于单管放大电路为何能实现更高的电压增益？其增益提升的主要机制是什么？是否会影响电路的输入输出阻抗与频率响应特性？
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祁圆圆 2025-10-10 09:20关注<html></html>双管级联放大电路增益提升机制及其对阻抗与频率响应的影响
1. 单管放大器的基本增益模型
在小信号放大电路设计中，单管共射（BJT）或共源（MOSFET）结构是最基础的拓扑之一。其电压增益可表示为：
A_v = -g_m \cdot R_L其中，\(g_m\) 为晶体管跨导，\(R_L\) 为负载电阻。该表达式揭示了增益受限于跨导与负载的乘积。然而，在实际工艺条件下，\(g_m\) 受限于偏置电流和器件尺寸，而 \(R_L\) 过大会导致直流压降过大，限制输出摆幅。
- 典型BJT共射电路增益：50–200 V/V
- MOS共源电路增益：20–100 V/V（取决于工艺）
- 增益瓶颈主要来自有限的输出阻抗
2. 双管级联结构的基本构成
常见的双管级联结构包括：
结构类型 前级 后级 应用场景 共射-共基（Cascode） 共射 共基 高频BJT放大器 共源-共栅（Cascode） 共源 共栅 CMOS模拟前端 折叠式共源共栅 共源 共栅 低电压运放 电流镜级联 共源 共栅 高精度偏置电路 宽带差分对 共射 共基 RF混频器 OTA输入级 共源 共栅 连续时间滤波器 低噪声放大器 共源 共栅 射频接收链路 高PSRR LDO 共源 共栅 电源管理 高速比较器 共射 共基 ADC前端 跨阻放大器 共源 共栅 光电检测 3. 增益提升的核心机制：输出阻抗倍增
双管级联实现更高电压增益的关键在于显著提升交流输出阻抗。在单管共源/共射结构中，输出阻抗约为 \(r_o\)（晶体管本征输出阻抗）。而在级联结构中，输出阻抗近似为：
R_{out} \approx r_{o2} + r_{o1}(1 + g_{m2} r_{o2}) \approx g_{m2} r_{o1} r_{o2}该等效阻抗远大于单管的 \(r_o\)，从而使得总增益变为：
A_v = -g_{m1} \cdot R_{out} \approx -g_{m1} g_{m2} r_{o1} r_{o2}此增益可比单管结构高出一个数量级以上，尤其在深亚微米CMOS工艺中更为显著。
4. 输入与输出阻抗的变化分析
级联结构对端口阻抗特性产生显著影响：
- 输入阻抗：基本保持不变，仍由前级（共源/共射）决定，约为 \(1/g_m\)（MOS）或 \(\beta r_e\)（BJT）
- 输出阻抗：从 \(r_o\) 提升至 \(g_m r_o^2\) 量级，实现“阻抗变换”效应
- 中间节点阻抗：共栅/共基级引入低输入阻抗节点，抑制密勒效应
- 驱动能力：高输出阻抗意味着带负载能力下降，需缓冲级配合
5. 频率响应特性的优化机制
双管级联不仅提升增益，还改善频率响应：
graph LR A[输入信号] --> B(共源/共射级) B --> C[高增益放大] C --> D(共栅/共基级) D --> E[高阻抗输出] B --> F[Miler电容被屏蔽] D --> G[减小输入到输出寄生反馈] F --> H[带宽提升] G --> H H --> I[增益带宽积GBW提高]关键优势包括：
- 共栅级作为“电流缓冲”，隔离前级漏极与输出节点，削弱密勒乘法效应
- 主极点向高频移动，单位增益带宽提升30%~100%
- 次级极点控制更易，相位裕度改善
- 适用于GHz级射频与高速数据转换系统
6. 实际设计中的权衡考量
尽管级联结构优势明显，但也带来设计复杂性：
参数 单管结构 级联结构 影响说明 电压增益 中等 高 提升2–10倍 输出摆幅 大 受限 多级压降降低动态范围 功耗 低 较高 增加1个偏置支路 面积 小 大 额外晶体管占用版图 噪声 中等 略高 第二级引入额外热噪声 PSRR 一般 优 级联增强电源抑制 匹配要求 低 高 差分对需良好匹配 工艺偏差敏感性 中 高 阈值电压漂移影响大 温度稳定性 好 需补偿 跨导温漂叠加 设计复杂度 低 高 需优化偏置与频率补偿 7. 工艺与偏置条件下的性能对比
在相同工艺节点（如65nm CMOS）与总偏置电流（如1mA）下，对比两类结构：
单管共源：A_v ≈ g_m × r_o = 4 mS × 50 kΩ = 200 V/V
共源-共栅：A_v ≈ g_m1 × (g_m2 r_o1 r_o2) ≈ 4 mS × (4 mS × 50k × 50k) ≈ 40,000 V/V实际由于寄生电容与沟道长度调制效应，有效增益约为理论值的30%~50%，但仍可达8,000–15,000 V/V，远超单管结构。
此外，级联结构的输出极点频率为：
f_{p2} = \frac{1}{2\pi R_{out} C_{load}}因 \(R_{out}\) 增大，极点频率降低，但输入极点因密勒效应抑制而大幅右移，整体系统带宽得以扩展。
8. 高级应用与演进结构
基于基础级联结构，已发展出多种高性能变体：
- 折叠式共源共栅：允许更低电源电压操作
- 增益增强型运算放大器：使用辅助放大器进一步提升开环增益
- 电流级联（Active Cascode）：用有源电路替代恒流源，提升输出摆幅
- 体偏置调节技术：动态调整阈值电压以优化跨导与噪声
- 多级级联：三级以上堆叠实现超高增益（如 > 100 dB）
- SOI工艺级联：利用绝缘衬底降低寄生电容，提升速度
- FinFET级联：三维结构增强栅控能力，减小短沟道效应
- 异质结HBT级联：用于毫米波通信，突破f_T限制
- 自适应偏置级联：根据信号强度动态调节工作点
- 数字辅助模拟级联：结合校准算法补偿失配
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