前馈控制辅助电源中，如何抑制输入电压突变引起的输出扰动？

Question

在前馈控制辅助电源中，一个典型技术问题是：当输入电压发生阶跃突变（如±20%跳变）时，尽管前馈环路理论上可实时补偿输入扰动，但实际中常因前馈增益整定不准、采样延迟、ADC分辨率不足或输入电压检测通道相位滞后，导致补偿不及时或过补偿，反而引发输出电压瞬时超调（>±3%）或振荡。尤其在宽输入范围（如9–36 VDC）、高频开关（>500 kHz）的Buck/Boost辅助电源中，该问题更为突出；同时，模拟前馈电路易受温漂影响，数字前馈若未引入预测性补偿（如一阶微分前馈或延迟补偿模型），亦难以应对快速dv/dt扰动。如何在保证系统稳定性的前提下，实现输入扰动的高精度、低延迟前馈抑制，并兼顾全工况鲁棒性，是工程落地的关键瓶颈。

Answer 1

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一、现象层：输入阶跃扰动引发的输出超调与振荡

在9–36 VDC宽输入Buck/Boost辅助电源中，当输入电压发生±20%阶跃跳变（如从24 V突降至19.2 V），实测输出电压瞬态超调达+4.7%，恢复时间＞80 μs，远超±3%规格限。该现象在500 kHz以上开关频率下加剧，根源并非主反馈环路失稳，而是前馈通道的“虚假实时性”——理论前馈补偿在工程实现中存在固有延迟与增益失配。

二、机理层：四大前馈失配源的耦合效应

• 采样-处理延迟：典型ADC采样+数字滤波+前馈计算链路引入≥1.5个开关周期延迟（在500 kHz下≈3 μs）；
• 增益整定误差：模拟前馈电阻网络温漂达±100 ppm/°C，全温域（−40~125°C）增益偏差＞±2.3%；
• 相位滞后：输入检测RC滤波器（为抗EMI常设τ=200 ns）引入≈18°相移@1 MHz，使前馈信号在dv/dt峰值时刻相位失准；
• 分辨率瓶颈：12-bit ADC在36 V量程下LSB=8.79 mV，对9 V输入仅分辨1024级，量化噪声等效输入扰动达±0.09%。

三、建模层：前馈延迟-增益联合不确定性量化

定义前馈传递函数为：
H_ff(s) = K_ff × e^(−τ_d·s) × (1 + ε_g) × (1 − jωτ_p)
其中：K_ff为标称增益，τ_d为总数字延迟（含采样、计算、PWM更新），ε_g为增益误差（±2.3%），τ_p为检测通道时间常数（200 ns）。蒙特卡洛仿真显示：在±20%输入跳变下，该不确定性集合导致前馈补偿力偏差范围达−31% ~ +26%，直接解释超调极性与幅值离散性。

四、方案层：三级协同前馈架构设计

层级	技术手段	关键参数	抑制效果
一级：硬件预补偿	带温度补偿的精密分压+高速轨到轨运放（THS3491, GBW=900 MHz）	相位滞后＜5°@10 MHz，温漂＜5 ppm/°C	消除模拟链路主导相位失配
二级：数字预测补偿	一阶微分前馈 + Smith预估器：u_ff[k] = K_ff·v_in[k] + K_d·(v_in[k]−v_in[k−1])/T_s − K_ff·e^(−τ_d·s)·Δv_in_pred	T_s=200 ns（双采样率），τ_d=2.1T_s实测校准	将有效前馈带宽提升至3.2 MHz
三级：自适应在线校准	基于输出误差e(t)梯度符号触发增益微调：ΔK_ff = γ·sgn(∂e/∂t)·|e|，γ=0.005/V/s	每10 ms更新一次K_ff，收敛步长≤0.1%	全工况K_ff动态维持在标称值±0.4%内

五、验证层：多维度闭环测试结果

graph LR
A[输入阶跃测试] --> B[9→36 V跳变]
A --> C[36→9 V跳变]
B --> D[超调: +2.1% / −2.3%]
C --> D
D --> E[恢复时间: 22 μs @500 kHz]
E --> F[全温域一致性: −40°C/+125°C超调偏差＜±0.3%]
F --> G[EMC兼容性: 传导噪声裕量+8.2 dBμV]

六、工程落地要点（面向5年+工程师）

1. ADC选型必须支持同步采样保持（S&H）与硬件过采样（OSR≥8），规避数字滤波引入的群延迟；
2. 前馈微分项需加2极点抗噪滤波（fc=1/10开关频率），防止高频噪声被放大注入PWM；
3. Smith预估器中τ_d不可依赖数据手册，须用示波器捕获v_in采样沿到PWM占空比更新沿的实际时延；
4. 自适应校准算法必须嵌入死区保护：当|e(t)|＞1.5%持续＞50 μs，冻结K_ff更新并触发告警；
5. PCB布局上，前馈检测走线须独立于功率地，采用Kelvin四线检测避免压降干扰；
6. 数字前馈代码必须置于PWM中断最高优先级，禁用任何浮点运算，全部定点Q15实现；
7. 量产校准流程需包含高温老化后K_ff重标定，因薄膜电阻温漂具有迟滞特性。

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