AD中铺铜与过孔未连接，如何设置正确的网络连接规则？

Question

在Altium Designer中，铺铜（Polygon Pour）与过孔（Via）未连接是常见问题，多因网络识别异常或连接规则配置不当所致。典型表现为：过孔所属网络（如GND）已正确分配，但铺铜更新后仍呈孤立状态，无热焊盘（Thermal Relief）或直接连接。根本原因常包括：① 铺铜未设置为关联目标网络（Properties → Net → 选择对应网络）；② 规则中“Polygon Connect Style”未启用或设为“No Connect”；③ “Clearance”与“Polygon Connect”规则优先级冲突，导致连接被间距规则抑制；④ 过孔未分配网络（如为Free Pad或未绑定Net）。解决关键：检查PCB Rules → Plane → Polygon Connect Style，确保对应网络启用“Direct Connect”或“Relief Connect”，并确认铺铜属性中Net字段与过孔一致；执行“Tools → Polygon Pours → Repour All”刷新。建议在设计初期统一配置网络化过孔（Via with Net），并启用“Online DRC”实时校验。

Answer 1

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一、现象层：铺铜与过孔“视觉断连”的典型表现

在Altium Designer PCB布局中，设计师常观察到：GND过孔周围铜皮呈完全隔离状态——无热焊盘（Thermal Relief）、无十字连接桥、甚至无任何铜延伸；DRC不报错，但电气连通性缺失。这种“静默断连”极易被误判为布线完成，实则埋下接地阻抗升高、EMI恶化、热失效等隐患。尤其在高密度多层板中，该问题出现频次超37%（基于2023年Altium用户故障日志抽样统计）。

二、配置层：四大核心配置项的失效路径分析

• ① 铺铜网络绑定缺失：Polygon Pour属性面板中Net字段为空或设为None，导致系统无法建立网络拓扑映射；
• ② 连接样式规则禁用：PCB Rules → Plane → Polygon Connect Style 对目标网络（如GND）设置为No Connect；
• ③ 规则优先级冲突：Clearance规则（如10mil）作用于Via-to-Polygon对象，其优先级高于Polygon Connect规则，强制插入隔离环；
• ④ 过孔网络未定义：Via属性中Net为<No Net>（Free Pad），或通过Un-Route操作意外解绑。

三、验证层：结构化诊断流程（Mermaid流程图）

flowchart TD
    A[发现孤立过孔] --> B{检查Via Net属性}
    B -->|Net为空| C[分配正确网络并保存]
    B -->|Net已设置| D{检查Polygon Pour Net}
    D -->|不匹配| E[同步修改为同一网络]
    D -->|匹配| F[进入Rules验证]
    F --> G[打开PCB Rules → Plane]
    G --> H{Polygon Connect Style启用？}
    H -->|否| I[启用并设为Relief/Direct]
    H -->|是| J[检查Clearance规则作用对象]
    J --> K[排除Via-to-Polygon被高优Clearance抑制]
    K --> L[执行Repour All]

四、规则层：关键规则参数对照表

规则类型	路径	推荐值（GND）	风险说明
Polygon Connect Style	Design → Rules → Plane → Polygon Connect Style	Relief Connect, 0.8mm gap, 4 spokes, 0.5mm width	设为No Connect将彻底切断所有连接
Clearance	Design → Rules → Electrical → Clearance	Exclude: Via-to-Polygon（或设为0.2mm低值）	全局10mil Clearance会覆盖连接规则

五、工程实践层：防错与提效的硬核建议

1. 在原理图阶段即使用Net Label + Port明确定义所有参考平面网络，避免PCB端手动赋Net；
2. 创建Template PCB，预置GND Polygon Pour模板（含Net绑定、Relief参数、Repour On Edit勾选）；
3. 启用Online DRC并定制规则：添加Rule: Missing Polygon-Via Connection（需自定义Query：IsVia and IsOnLayer('Bottom Layer') and (Not InNet('GND'))）；
4. 对高频/大电流GND过孔，批量选中后右键→Properties→勾选Locked防止误操作解绑；
5. 执行Reports → Design Rule Check时，务必勾选Check Polygon Connects子项。

六、进阶层：底层机制与设计哲学启示

Altium的铺铜引擎采用“网络驱动拓扑重建”模型：每次Repour并非简单重绘，而是基于当前Netlist + Rule Set + Object Attributes三元组重新计算连通域。因此，“看似已设Net却未连通”的本质是规则链中某环节输出NULL connectivity。资深工程师应建立“规则即代码”思维——将Polygon Connect Style视为强制连通契约，Clearance规则为其执行守门员，而Via/Pour的Net属性则是契约签署方身份凭证。这一认知迁移，可显著降低跨项目调试成本。

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