大腿们，AD9361收发不是有IQ两路信号吗，这两路信号是不是一定只能是等幅度的正交的sin和cos信号？假如我的收发频段是2.4G，那我能不能直接进行QAM映射后直接分别把数据送到IQ两路，通过ad9361的混频器实现调制和解调？
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- 2022-12-14 09:22回答 1 已采纳 定量分析的话，一般是用有线电缆加衰减器，最好在无线屏蔽箱内进行，空气和天线的衰减不好计算
- 2021-11-13 22:44回答 1 已采纳 一般定时器中处理的任务需要尽量短，但说实话比较型adc转换时间一般是微妙级别的不会有太大影响，除非用了外置ADC或者定时器频率很高，可以尝试改成dma
- 2022-07-01 15:05回答 1 已采纳 1 Auto CAD unit == 37/18 mm 就好啦，不过尺寸还是再量精确些，最好看看CAD里的比例尺是多大的
- 2024-07-09 16:37FPGAmaster创新者的博客 本篇文章将介绍如何通过AD9361发射QPSK信号以及纯verilog代码实现和讲解。 QPSK (Quadrature Phase Shift Keying) 是一种广泛使用的数字调制方式，它通过改变载波的相位来传输数据。QPSK 实现 IQ 调制解调的基本原理...
- 2023-02-07 22:55回答 1 已采纳 该回答引用ChatGPT是的，通常在处理音频数据时，AD转换后得到的数据是无符号数，需要先在FPGA中将其转换为有符号数再进行处理，最后再转换回无符号数并发送给DA转换进行输出
- 2022-02-16 23:05回答 1 已采纳 1.干扰，噪声2.信号本身通过放大，滤波等电路时发生了形变，产生的高频噪声及高次谐波。3.信号在传输过程中发生的反射，叠加产生的信号形变。4.ad转换本身的噪声波动。
- 2023-03-22 21:16回答 1 已采纳 在 Altium Designer 中，Properties 对话框显示的是当前选中对象的属性。如果您选择的是一个矩形（Rectangle）对象，那么 Properties 对话框中就会显示矩形的属性
- 2024-06-26 14:23FPGAmaster创新者的博客 本篇文章将介绍如何通过AD9361发射FSK信号以及纯verilog代码实现和讲解。
- 2023-02-17 09:10回答 8 已采纳 您好，错误提示无效的分区数据读写序列，请检查电源连接。请您尝试以下操作来解决您的问题：1、检查AD5933的接口连接是否正常，可以通过更换接口或者连接线等方式来解决此问题2、检查自带的软件安装是否有问
- 2022-06-29 22:23回答 1 已采纳 高精度 AD 采集本身就非常容易被干扰。提高 AD 采集抗干扰能力需要从软件和硬件方面同时考虑。硬件措施： 1：AD 前端的运放电路需要选择低温漂的芯片。阻容件选高精度的。 2：AD 前端
- 2022-06-12 23:22回答 1 已采纳 这个是残留的走线，你放大看就看到了
- 2024-07-04 17:43FPGACores的博客 BPSK调制一般只需要I路信号与余弦载波相乘输出即可，但本实验采用AD9361作为正交调制芯片，需要输入IQ两路信号，令Q路信号为0即可。 AD9361输出BPSK频谱图
- 2023-01-15 14:58回答 3 已采纳 立创商城 直接找相同封装的元件然后下载其文件导入
- 2024-06-25 23:22老顽童FPGA的博客 对于数字信号调制，都采用IQ正交调制，包括MSK、QAM等其他调制均是如此，利用前面博客所写的接口函数和转换软件，将重点只关注调制信号本身设计，不用再考虑AD9361接口问题，将更多的经历关注到信号设计本身，对于AD...
- 2023-11-02 17:20Ryan064的博客 用状态机，定义frame_cnt记八个数，表示传I1高，Q1高，I1低，Q1低，将rx_data_frame 转成I1,Q1,I2,Q2四路数据。差分RX_FRAME转单端后，I2高，Q2高，I2低，Q2低。编写Verilog代码如下。
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